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プロファイル
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氏名・所属
岩田 穆( いわた あつし)
iwa@dsl.hiroshima-u.ac.jp

広島大学大学院先端物質科学研究科
量子物質科学専攻
教授
略歴
1968.3. 名古屋大学工学部電子工学科卒業
1970.3. 名古屋大学大学院工学研究科修士課程電子工学専攻修了
(工学修士)
1970.4. 日本電信電話公社武蔵野電気通信研究所研究員
1982.2. 日本電信電話公社厚木電気通信研究所研究専門調査役
1984.2. 日本電信電話公社厚木電気通信研究所研究室長
1991.2. 日本電信電話株式会社LSI研究所研究部長
1993.8. NTTエレクトロニクステクノロジ株式会社副本部長
1994.4. 工学博士(名古屋大学)
1994.4. 広島大学工学部教授(集積回路工学)
1999.4. 広島大学大学院先端物質科学研究科教授(機能集積システム)
2001.4. 広島大学ナノデバイス・システム研究センター長
所属学協会 Institute of Electrical and Electronics Engineers (IEEE)、
電子情報通信学会、神経回路学会
世界水準の成果 オーバーサンプリングAD変換機 (MASH) (ISSCC1987)
高次デルタシグマ方式の提案、主流化
16ビット制度達成、デジタルオーディオの主流
アナデジ融合生体情報処理回路と画像特徴連想チップ (ISSCC1997, 2000)
パルス変調並列演算回路
AD混載クロストーク雑音解析、低雑音ロジック設計
アナデジ融合回路の概念と有効性
先駆的な研究成果 光電融合集積回路の概念 (U-OEIC)
非線形ニューラルネット (画像処理応用)
産官学連携 CREST、STARC、NEDO、広島産業科学技術研究所
主な発表論文名
1. Yasuyuki Matsuya, Kuniharu Uchimura and Atsushi Iwata,
A 16-bit Oversampling A-to-D Conversion Technology Using Triple-Integration Noise Shaping
IEEE J. of Solid-State Circuits, Vol. SC-22, No. 6, pp. 921-929, (1987)
2.  Kuniharu Uchimura, Toshio Hayashi, Tadakatsu Kimura and Atsushi Iwata,
Oversampling A-to-D and D-to-A Converters with Multi-stage Noise Shaping Modulators
IEEE Trans. ASSP, Vol. 36, No. 12, pp. 1899-1905, (1988) 
3. Atsushi Iwata and Izuo Hayashi ,
Optical Interconnections as a New LSI Technology
IEICE Trans. Electron. Vol. E76-C, No. 1, pp. 90-99, (1993)
4. Atsushi Iwata and Makoto Nagata,
A Concept of Analog-Digital merged Circuit Architecture for Future VLSI's
IEICE Trans. Fundamentals of Electronics, Communications and Computer Sciences Vol. E79-A, No.2, pp.145-157, (Feb. 1996)
5. M. Nagata, J. Funakoshi and A. Iwata ,
A PWM Signal Processing Core Circuit Based on a Switched Current Integration Technique
IEEE Journal of Solid-State Circuits, Vol.33, No.1, pp.53-59, (Jan. 1998) 
6. M. Nagata and A. Iwata,
Substrate Noise Simulation Techniques for Analog-Digital Mixed LSI Design
IEICE Trans. Electronics, Vol. E82-A, No.2, pp.271-278, 1999. 
7. Astushi Iwata, T. Morie, and M. Nagata,
Merged Analog-Digital Circuits Using Pulse Modulation for Intelligent SoC Applications (Invited)
IEICE Trans. Fundamentals, Vol. E84-A, No. 2, pp. 486-496, 2001.
8. M. Nagata, J. Nagai, K. Hijikata, T. Morie, and A. Iwata,
Physical Design Guides for Substrate Noise Reduction in CMOS Digital Circuits
IEEE J. Solid-State Circuits, Vol. 36, No. 3, pp. 539-549, March 2001.
研究室ページ http://www.dsl.hiroshima-u.ac.jp/
個人ページ http://www.dsl.hiroshima-u.ac.jp/~iwa/
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